UG7128D7488LP-EB - Unigen Corporation

Preliminary

UNIGEN CONFIDENTIAL

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UG7128D7488LP

SYNCHRONOUS

DRAM MODULE

1G Bytes (128M x 72 bits)

based on 18 pcs 64M x 8 DDR SDRAM 8K Refresh

184 Pin DDR SDRAM Unbuffered DIMM

PIN ASSIGNMENT (Front View)

184-Pin DIMM

PIN SYMBOL PIN SYMBOL PIN SYMBOL PIN SYMBOL

2 DQ0

3 VSS

4 DQ1

5 DQS0

6 DQ2

7 VDD

8 DQ3

9 NC

10 NC

11 VSS

12 DQ8

13 DQ9

14 DQS1

15 VDDQ

16 CK1

17 /CK1

18 VSS

19 DQ10

20 DQ11

21 CKE0

22 VDDQ

23 DQ16

24 DQ17

25 DQS2

26 VSS

27 A9

28 DQ18

29 A7

30 VDDQ

31 DQ19

32 A5

33 DQ24

34 VSS

35 DQ25

36 DQS3

37 A4

1 VREF

41 A2

38 VDD

39 DQ26

40 DQ27

42 VSS

43 A1

44 CB0

45 CB1

46 VDD

52 BA1

47 DQS8

48 A0

49 CB2

50 VSS

51 CB3

53 DQ32

64 DQ41

54 VDDQ

55 DQ33

56 DQS4

57 DQ34

58 VSS

59 BA0

60 DQ35

61 DQ40

62 VDDQ

63 /WE

65 /CAS

66 VSS

67 DQS5

68 DQ42

69 DQ43

70 VDD

71 NC

72 DQ48

73 DQ49

74 VSS

81 VSS

76 CK2

75 /CK2

77 VDDQ

78 DQS6

79 DQ50

80 DQ51

92 SCL

82 VDDID

83 DQ56

84 DQ57

85 VDD

86 DQS7

87 DQ58

88 DQ59

89 VSS

90 NC

91 SDA

93 VSS

104 VDDQ

94 DQ4

95 DQ5

96 VDDQ

98 DQ6

99 DQ7

100 VSS

101 NC

102 NC

103 NC

105 DQ12

106 DQ13

108 VDD

109 DQ14

110 DQ15

111 CKE1

121 DQ22

116 VSS

112 VDDQ

113 NC

114 DQ20

115 A12

117 DQ21

118 A11

120 VDD

132 VSS

122 A8

123 DQ23

124 VSS

125 A6

126 DQ28

127 DQ29

128 VDDQ

130 A3

131 DQ30

133 DQ31

134 CB4

135 CB5

136 VDDQ

137 CK0

138 /CK0

144 CB7

139 VSS

141 A10

142 CB6

143 VDDQ

145 VSS

146 DQ36

147 DQ37

148 VDD

161 DQ46

156 VDDQ

150 DQ38

151 DQ39

152 VSS

153 DQ44

154 /RAS

155 DQ45

157 /CS0

158 /CS1

172 VDDQ

162 DQ47

163 NC

164 VDDQ

165 DQ52

166 DQ53

167 NC

168 VDD

170 DQ54

171 DQ55

173 NC

184 VDDSPD

174 DQ60

175 DQ61

176 VSS

178 DQ62

179 DQ63

180 VDDQ

181 SA0

182 SA1

183 SA2

160 VSS

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FEATURES

ABSOLUTE MAXIMUM RATINGS

REVISION HISTORY

Rev - A Product brief released.

May 13, 2002

• Voltage Relative to GND -0.5 to + 4.6V

• Operating Temperature 0 to + 70°C

• Storage Temperature -55°C to + 150°C

• Short circuit Output Current 50mA

• Power Dissipation 18W

REF. CYCLE SDRAM

PACKAGE PLATING

UG7128D7488LP 8K 400mil

TSOP Gold

PART IDENTIFICATION

PART NO.

• 1GB (128Meg X 72)

• Quad internal banks operation

• Auto & self refresh capability (64ms/8K)

• SSTL_2 compatible inputs and outputs

• 2.5V ± 0.2V for VDDQ & VDD

• Programmable Mode register set

/CAS latency (2, 2.5)

Burst length (2, 4, 8)

• Data scramble ;Sequential & Interleave

• Double Data Rate architecture

• Differential clock inputs (CK , /CK)

• Data inputs and DM are synchronized with both

edges of DQS

• Data outputs and DQS are synchronized with a

cross point of CK and /CK

• Serial presence detect with EEPROM

• PCB : Height (1250mil), double sided component

97 DM0/DQS9

107 DM1/DQS10

119 DM2/DQS11

129 DM3/DQS12

140 DM8/DQS17

149 DM4/DQS13

159 DM5/DQS14

169 DM6/DQS15

177 DM7/DQS16

-EB CL2 10ns 100MHz

SPEED INFORMATION

Module Marking CAS Latency SPEED

-EZ CL2 7.5ns 133MHz

-DB CL2.5 10ns 100MHz

-DZ CL2.5 7.5ns 133MHz

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UG7128D7488LP

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Functional Block Diagram

Physical Dimension

A0 - A12 A0-A12: SDRAMs D0 - D17

RAS RAS: SDRAMs D0 - D17

CAS CAS: SDRAMs D0 - D17

CKE0 CKE: SDRAMs D0 - D8

WE WE: SDRAMs D0 - D17

CKE1 CKE: SDRAMs D9 - D17

BA0 - BA1 BA0-BA1: SDRAMs D0 - D17

* Clock Wiring

*CK0/CK0

Clock

Input SDRAMs

*CK1/CK1 6 SDRAMs

6 SDRAMs

* Wire per Clock Loading

Table/Wiring Diagrams

*CK2/CK2

Notes:

1. DQ-to-I/O wiring is shown a s rec omm end ed

but may be cha nged.

2. DQ/DQS/DM/CKE/S relationships must be

maintained as s hown .

3. DQ, DQS, DM/DQS resistors: 22 Ohms ± 5%.

Serial PD

A1 A2

SA0 SA1 SA2

SCL SDA

VDD

VSS

D0 - D17

VDDQ D0 - D17

D0 - D17

VREF

VDDSPD SPD

Tolerances : ± 0.005 unless otherwise specified Units : Inches

0.250

Detail A

0.071 ± 0.0039

2.175

0.1496

0.10 MCBA M

5.25 ± 0.006

5.077

0.100 Min

0.393

A B

2.55 1.95 2.500

0.700

0.10 MCBA

0.118

R 0.0787

0.1575

0.780

1.25 ± 0.006

0.157 Min

0.050 ± 0.0039

0.145 Min

0.050

0.0078 ± 0.006

Detail B

0.100

0.039 ± 0.002

DQ4

DQ5

DQ6

DQ7

DQ0

DQ1

DQ2

DQ3

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DM0/DQS9 DM

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DQ12

DQ13

DQ14

DQ8

DQ9

DQ10

DQ11

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D10

II/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DM1/DQS10

DQ20

DQ21

DQ22

DQ23

DQ16

DQ17

DQ18

DQ19

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D11

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DM2/DQS11

DQ28

DQ29

DQ30

DQ31

DQ24

DQ25

DQ26

DQ27

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D12

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DM3/DQS12

DQ36

DQ37

DQ38

DQ39

DQ32

DQ33

DQ34

DQ35

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DM4/DQS13

D13

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DQ44

DQ45

DQ46

DQ47

DQ40

DQ41

DQ42

DQ43

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D14

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DM5/DQS14

DQ52

DQ53

DQ54

DQ55

DQ48

DQ49

DQ50

DQ51

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D15

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DQ60

DQ61

DQ62

DQ63

DQ56

DQ57

DQ58

DQ59

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D16

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

DM7/DQS16

CS0 CS1

S S S S

SSS S

S S

DQS0

DQS

DQS4

DQS1 DQS5

DQS DQS

DQS2

DQS DQS

DQS3

DQS DQS

DM6/DQS15

DQS6

DQS7

DQ15

CB4

CB5

CB6

CB7

CB0

CB1

CB2

CB3

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D17

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

S S

DQS8

DM8/DQS17 DQS DQS

DQS

DQSDQS

DQS

DQS DQS DQS